基于FPGA基础知识的介绍和开发过程，使用Verilog HDL硬件描述语言实现了全自动洗衣机控制器。制器可以预设洗涤时间，并发出三个电动机控制信号，用于正向旋转，反向旋转和暂停。过成功的编译和仿真，程序被下载到DE0开发板上，可以准确地执行基本的控制功能，操作简单，性能稳定可靠。FPGA（现场可编程门阵列）设备诞生以来，FPGA行业发展迅速。方面，技术性能不断增强，加工技术从2μm发展到65 nm，晶体管的数量从85，000增加到超过10亿。常添加各种硬核和软核以实现常用功能。一方面，应用领域正在不断扩大，从传统的通信行业到消费电子，汽车和工业控制等非传统领域。高FPGA性能和降低成本已使其成为DSP，ASIC，ASSP和嵌入式处理器的永久市场，FPGA的开发和应用已形成了巨大的产业。FPGA的诸多优点为其在未来的信息设备和智能家电中的应用提供了广阔的前景，因此，积极研究FPGA在控制家电中的应用具有重要的商业价值。具有重要的社会意义。化的FPGA基本结构由6部分组成，分别是可编程输入/输出单元，基本可编程逻辑单元，集成块RAM，丰富的布线资源，低级集成功能单元和集成的专用硬核。入/输出单元简称为I / O单元，它们是芯片和外部电路的接口部分。了使FPGA具有更灵活的应用，目前大多数FPGA I / O单元都以可编程模式进行设计，也就是说，由于灵活的软件配置，不同的电气标准和规范物理I / O可以测试；自适应阻抗可以调节特性，电阻从上到下；您可以调整驱动器输出电流的大小。本的可编程逻辑单元是可编程逻辑的主体，可以根据设计灵活地修改其内部连接和配置，以实现不同的逻辑功能。本的可编程逻辑单元几乎全部由咨询表（LUT）和寄存器（寄存器）组成。部FPGA查找表通常包含4个条目，而搜索表通常完成纯组合逻辑的功能。部FPGA寄存器结构非常灵活，可以配置为带复位或同步/异步调整的触发，时钟激活或锁定。FPGA通常依靠寄存器来实现同步同步逻辑的设计。Altera的可编程逻辑单元通常称为LE，它由一个寄存器和一个LUT组成。今，大多数FPGA都具有内置的Block RAM。编程RAM模块集成在FPGA中，大大扩展了FPGA的应用范围和灵活性。常，可以将集成在FPGA中的Block RAM灵活配置为通用存储结构，例如单端口RAM，双端口RAM和FIFO。由资源连接FPGA内部的所有单元，布线的长度和过程决定了布线上信号的传导性和速度。实施过程中，设计人员通常不需要直接选择布线资源，但是布局和布线设备会自动选择可用于连接使用的基础单元模块的布线资源。
决于输入逻辑网表的拓扑和约束。层车载功能单元的概念更为笼统。们在这里指的是高度通用的板载功能单元，例如PLL，DLL，恒温阀芯DSP，CPU等。着FPGA的发展，这些模块越来越多地集成到FPGA中，以满足不同场合的需求。
里嵌入的专用硬核与先前的“低级嵌入单元”不同。里提到的板载专用硬核主要是指相对来说通用性较差并且不包括所有FPGA的硬核。
FPGA内部有两个阵营：一方面，FPGA用途广泛，目标市场范围广，价格适中；另一方面，FPGA具有广泛的用途。一方面，FPGA具有较高的相关性，明确的目标市场和较高的价格。一个是指低成本FPGA，而第二个是指某些高端通信市场中的可编程逻辑器件。WD是由Youjing公司推出的FPGA多媒体开发平台，用于大学教学和研究，具有灵活可靠的外围接口设计。WD可以帮助用户快速掌握SOPC的使用和开发。WD使用的基本FPGA芯片是Cyclone II系列EP3C15E484C6，这是一种低成本的FPGA芯片。功能如表1所示。外，WD还包含许多硬件外设和接口，包括8M SDRAM，4M FLASH，SD卡接口，3个键，10个拨动开关，10个红色LED，输出端子VGA，USB主控制器和ISP1362从控制器和接口，RS232 MAX232收发器和串行接口，PS / 2鼠标键盘连接器，2X16字符LCD模块，4个数字管，64个外围I / O接口。衣机是一种清洁设备，利用电能产生机械作用来洗涤衣物，是我们日常生活中最常用的设备之一。文档中设计的洗衣机控制器必须能够控制电动机以完成最基本的洗衣机周期，并且具有良好的界面和良好的可操作性。制器必须能够执行以下基本功能：正向循环输出旋转，反向旋转，暂停信号；可以预设洗涤时间；可以显示输入同步；良好的可操作性和可靠性。了方便计时，首先将外部时钟从50 MHz划分为1 Hz，将正向旋转时间设置为20 s，将反向旋转设置为20 s，将暂停设置为10 s，以便使用洗衣机衣物在旋转20 s之前依次旋转，暂停10 s，反转20 s，暂停10 s，然后旋转20 s。期恰好是1分钟。
此，有必要设计分钟计数器和第二计数器。个周期中有4个状态。管两个暂停状态都重复，但四状态机的设计目的是易于控制。态机如图1所示。态机设计为S1（前），S2（暂停），S3（后）和S4（暂停）。志电平的变化用作状态转换的条件。您按下开始键时，标志电平会根据20 s-10 s-20 s-10 s规则周期性变化。2显示了洗衣机控制器的工作流程图，为便于操作，每个模块都配置为按顺序运行。有按下复位按钮才能输入时间，按下开始按钮时，状态机开始运行，此时不能更改时间；当定时器不为零时，状态机和定时器工作；分钟定时器为零时，系统复位；如果要提前结束程序，则只能按复位按钮。
据以上分析，洗衣机电路可分为五个模块进行设计：分频模块，分钟倒数模块，第二倒数模块，洗衣机模块状态和解码器模块。频模块将50 MHz的时钟mclk划分为1 Hz的时钟clk，该模块的电路如图3所示。模块的电路图如图4所示。d1是时间条目。
数开始时，每当clk的上升沿到达时，t3就会递减并发送。倒数为零时，t3_0发出高电平。模块的电路图如图5所示。倒计时开始时，每当clk的上升沿到达时，t4递减并发送。倒数为零时，标志电平反转并发出。
mclk的上升沿到达时，如果标志的级别改变，则状态机进入下一个状态。块电路如图6所示。mclk的上升沿到达时，解码器以7位数字显示格式对4位输入t3h，t31，t4h和t4l进行解码，并按t1h，t1l输出它们。
t2h和t2l。
块电路如图7所示。理图输入法用于将模块电路图连接在一起以生成如图8所示的整个电路。
拟如图9所示。图9所示，在重置后，通过按d1键，t3h会增加1。按下开始键时，t4开始计时，然后前进，停止和倒带以产生高电平循环，表明程序正确并达到了设计要求。QuartusII软件平台上，已经通过使用Verilog HDL语言编程来实现洗衣机控制器。
功编译并将其上传到DE0开发板后，已完全满足控制要求。控制器易于使用，可用于洗衣机控制器的实际设计中。
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