在设计全彩LED宽屏同步显示控制系统时，需要采集从源计算机图形卡发送的视频图像信号，并将其传输到远程大屏幕同步显示。于高视频信号速率和实时同步显示要求，SRAM ZBT用作高速视频信号的缓冲器。用ZBT SRAM读写操作之间的快速切换，提出了一种读写存储方法。试仿真表明，该方法节省了大量存储空间，特别适用于屏幕分辨率高，实时性要求高的场合。型彩色LED显示屏，同步显示;交替阅读和写作; ZBT SRAM®对大屏幕彩色控制器ZBT SRAM同步显示控制系统的LED GrandLIUJia1，2GAOYang2CAI林飞3，周Yan1，LIJunyan1 ，2，梁Zhengkai3（1.信息工程学院，大学，西南科技的技术，绵阳，621010，中国; 2.Institut电子工程，四川绵阳621900，中国;冀州国家批准的企业技术中心，深圳518104）摘要：在大型彩色LED屏幕上设计同步显示控制系统，有必要收集视频图像由计算机图形卡作为视频源发送的信号，并将信号传输到大型LED屏幕进行同步显示。于视频信号的高速度和同步显示的实时显示需求，使用ZBT SRAM进行高速视频信号存储。用之间读写的Nd，存储交替读写的方法的快速切换的优点是模拟的proposée.Le调试表明，该方法节省了大量空间stockage.Il的特别适用于具有大屏幕高分辨率和高实时需求。键词：大彩色LED显示屏，同步显示;交替写作/阅读; ZBTSRAM简介在设计彩色LED大屏幕同步显示控制系统时，需要在计算机图形卡的DVI接口中采集视频图像信号。这些信号发送并传输到大型彩色远程LED显示屏，以便同时显示。们设计的全彩LED大屏幕同步显示控制系统基于超五类双绞线传输，可以传输和显示800×512分辨率的彩色图像， 60 Hz帧速率和256级单色灰度。统全彩LED全屏同步显示控制系统如图1所示。包括数据采集，数据处理，数据传输和显示驱动。屏幕控制系统的框图LED的数字视频接口使用DVI显卡，使用FPGA来路由数据流水线发送器板的处理中，如图2所示。2发送卡的数据处理的示意图在图2中，缓冲器缓冲数据以便减少数据处理的频率。示区域选择模块控制从外部存储器接收数据并选择要显示的区域数据。γ校正模块校正灰度数据由于LED是线性显示装置，因此逆γ校正以线性关系校正控制电压和亮度之间的关系，从而LED可以正常显示。行 – 串行转换将并行数据序列化以进行传输。述模块由同步控制器同步。据上述彩色LED大屏幕同步显示控制系统的设计规格，视频信号对图像的存储容量达到800×512×249.4MB。频信号的速率是800×512×24×60×590 MB /S，视频数据流量大，实时性要求高，高速视频信号必须首先被存储在外部缓存，外部存储器必须具有大容量，并且读写转换时间很短。前用作高速缓存的外部存储器是DRAM，SRAM，SDRAM等。DRAM的存储容量低，普通SRAM的容量也减小，并且读和写操作的频繁切换需要一段时间不活动并且其效率低。
管SDRAM具有大容量，但在随机访问期间存在许多附加操作，并且其有效性低。选择了三星ZBT（Zero-Bus Turnaround）SR7芯片K7M163635B作为缓冲器。过有效地使用系统总线，SRAM ZBT芯片消除了随机访问期间读写操作之间的转换周期，从而显着减少了读写延迟。K7M163635B的ZBTSRAM是一种类型的同步SRAM的突发简化界面，其通过消除倾斜或读出和写入操作之间的空闲时段解决高速SRAM和低延迟并使用所有带宽。
求，特别适用于具有大量读写开关的应用。
准同步突发SRAM需要2-3个不活动周期，总线从一个状态转换到另一个状态，从读状态到写状态，这降低了总线利用率和带宽可用。3比较了标准同步突发和SRAM ZBT中SRAM读写操作的时序。图3中，inactive表示不活动的时间段。3用于读取和写两个ZBT SRAM SRAM比较转换定时的具有流过接口模式和流水线，取两支撑TTL接口标准和CMOS I / O。通模式，读取命令可以在一个时钟周期后读取，写入命令可以在一个时钟周期后写入。流水线模式下，可以在两个时钟周期后读取读取命令，并且可以在两个时钟周期后写入写入命令。MK7M163635B的存储容量为512k×36b。口信号主要包括时钟信号，控制信号，地址总线和数据总线。时钟信号提供了用于执行各种操作，包括读，写操作的存储器控制信号，主要包含ADV WE_N，CKE_N，OE_N，LBO_N等的控制信号ADV是地址控制信号当ADV设置为高电平时，内部寄存器加载的新地址对于当前寄存器地址为1如果ADV设置为低电平，则内部寄存器加载外部地址; WE_N是读/写命令信号，WE_N被定义。CKE_N是时钟的验证信号;当CKE_N设置为高电平时，忽略当前条目，存储器保存前一个时钟周期的输出数据，如果设置为低电平，则运行正常; OE_N是输出的激活信号。置为高时，禁用数据输出。置低电平时，允许数据输出。LBO_N是突发模式控制信号。置低电平时，存储器处于线性突发模式。取的数据根据存储地址，存储器为交错突发模式，读取数据根据存储地址进行缩放。址总线SA [18-0]提供存储单元的地址寻址信号，用于读写操作; DQ数据总线[35-0]用于在读写操作期间与外部交换数据。K7M163635B接口控制器根据接口信号和ZBT SRAM的时序要求的设计设计中，作者使用了FPGA EP1C6Q240C8 Altera的Cyclone系列，用于产生接口信号和操作ZAM SRAM。FPGA工作在40 MHz SR和SRAM ZBT，频率为80 MHz。接口控制器电路图和ZBT SRAM在图4中。4 4控制器接口和结构与连接接口控制器ZBT SRAM的函数被示出（参见图5），则接口控制器主要由传输层部分，传输延迟部分，数据输入和输出的控制部分，时钟的控制部分组成。5图5接口控制器结构图接口控制器同步的设计和优点读取和写入SRAM ZBT时，必须在控制器上生成适当的控制信号。址总线和数据总线。如，当时钟信号的上升沿到达并产生相应于ADV，CKE_N，WE_N的管脚控制信号在读操作（图6）正在产生的地址总线上的地址，OE_N等，在下一个时钟。
升沿从地址总线读取数据。
前，SRAM或SDRAM用于缓冲视频信号。存储信号帧之后，读取所有内容，然后在读取之后存储信号的下一帧。用SRAM存储器的缺点是所需的容量很大并且难以选择芯片。于此设计的技术规范，所需的SRAM容量（即单帧视频信号的大小）为800×512×24×9.4 Mb。
果宽屏分辨率为1024×768且颜色方案不变，则所需的SRAM存储器大小为1024×768×2418MB.SDRAM是由于许多额外的操作会影响访问速度，这很难实时保证。6图6同步读操作K7M163635B在此设计中，视频源计算机的显示模式被设置为800×600在60赫兹和在屏幕的顶部的800×512区域必须被清除作者使用DVI接口的HS输出。步）信号以实现的方式计数。0≤HS≤511时，DVI发出要在屏幕上显示的区域，控制器处于读写状态;对于512≤HS≤599，DVI接口不需要在屏幕上显示区域，控制器处于空闲状态。
该显示模式中，DVI接口的输出信号具有40MHz的点频率。读取和写入备用存储器中的方法被设计：从FPGA中的有效像素的数据点，存储器切换到备用状态的读/写周期和操作按照“写读 – 写作阅读……“从前一个周期开始。钟的上升沿将一个像素的数据写入存储器，然后在下一个时钟上升沿读取它。于数据在写入内存后立即被读取，因此该方法实际上使用单个内存地址，这大大节省了存储空间并使内存选择更加灵活。外，SRAM ZBT具有快速的读写速度，无需额外的操作即可满足实时的高要求。
工作频率下，视频源的点频率为40 MHz，接口控制器的工作频率设置为80 MHz，这种工作模式完全满足时序要求。拟调试结果基于上面的接口信号和状态转换分析，使用Quartus II仿真软件调试，波形如图7，图7所示图7是另一个读/写状态的波形，图8是从另一个读/写转换到无效状态的波形。图的状态定义为：s0，SRAM ZBT的不活动状态，s1，SRAM ZBT中的数据写入; s2，读取SRAM ZBT中的数据。图中可以看出，PLC可以在读和写状态之间连续切换，并可以返回到空闲状态。出数据流与输入数据流一致，并且具有不同于2个时钟周期的位置。果表明，SRAM ZBT可以根据预期的时序正常工作。7图7交替读写状态仿真波形图8交替读写转换到不活动状态仿真波形结论使用新的ZBT SRAM器件采用循环交替读写方法，基于FPGA设计的SRGA ZBT接口控制器，满足具有大内存处理屏幕的彩色LED组同步显示控制系统发送卡的数据缓冲区。Quartus II软件仿真表明，解决了彩色LED大显示同步显示控制系统中缓存高速，实时，大容量视频信号的问题。方法显着减少了存储器中的存储空间并提供了高访问效率。特别适用于大型LED屏幕的分辨率较大且实时要求较高的情况。确提高接口控制器的工作频率，甚至用于分辨率大于1024×768的大型彩色LED显示器。考文献[1] Il Yongtai，Huang Wenqing。制器设计基于FPGA的SRGA ZBT接口[J]。动化技术与应用，2004（10）：49-51。[2] [JP 3]三星。
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究的主要方向是光电显示技术。周燕女，1983年出生，硕士学位。究的主要方向是EDA设计。李俊彦女，1984年出生，硕士学位。
究的主要方向是EDA设计。梁正义男，1979年出生，本科学生，九洲国家商务技术中心LED研发中心副主任，四个房间组成。究的主要方向是光电显示技术。
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